Blame SOURCES/0001-src-common-crc32c_intel_fast.patch
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--- ceph-15.2.2/src/common/crc32c_intel_fast_zero_asm.s.orig 2020-05-26 08:34:32.226201974 -0400
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+++ ceph-15.2.2/src/common/crc32c_intel_fast_zero_asm.s 2020-05-26 17:19:32.497201974 -0400
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@@ -1,5 +1,5 @@
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;
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12fe4d |
-; Copyright 2012-2013 Intel Corporation All Rights Reserved.
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12fe4d |
+; Copyright 2012-2015 Intel Corporation All Rights Reserved.
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12fe4d |
; All rights reserved.
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;
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; http://opensource.org/licenses/BSD-3-Clause
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@@ -59,6 +59,19 @@
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12fe4d |
xor rbx, rbx ;; rbx = crc1 = 0;
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12fe4d |
xor r10, r10 ;; r10 = crc2 = 0;
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6d8727 |
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+ cmp len, %%bSize*3*2
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12fe4d |
+ jbe %%non_prefetch
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12fe4d |
+
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12fe4d |
+ %assign i 0
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12fe4d |
+ %rep %%bSize/8 - 1
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+ crc32 rax, bufptmp ;; update crc0
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12fe4d |
+ crc32 rbx, bufptmp ;; update crc1
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12fe4d |
+ crc32 r10, bufptmp ;; update crc2
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12fe4d |
+ %assign i (i+8)
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+ %endrep
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+ jmp %%next %+ %1
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12fe4d |
+
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12fe4d |
+%%non_prefetch:
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12fe4d |
%assign i 0
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12fe4d |
%rep %%bSize/8 - 1
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12fe4d |
crc32 rax, bufptmp ;; update crc0
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12fe4d |
@@ -66,6 +79,8 @@
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12fe4d |
crc32 r10, bufptmp ;; update crc2
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12fe4d |
%assign i (i+8)
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12fe4d |
%endrep
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12fe4d |
+
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12fe4d |
+%%next %+ %1:
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12fe4d |
crc32 rax, bufptmp ;; update crc0
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12fe4d |
crc32 rbx, bufptmp ;; update crc1
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12fe4d |
; SKIP ;crc32 r10, bufptmp ;; update crc2
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12fe4d |
@@ -180,12 +195,15 @@
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12fe4d |
%define crc_init_dw r8d
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6d8727 |
%endif
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6d8727 |
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12fe4d |
-
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12fe4d |
+ endbranch
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12fe4d |
push rdi
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12fe4d |
push rbx
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6d8727 |
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mov rax, crc_init ;; rax = crc_init;
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12fe4d |
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12fe4d |
+ cmp len, 8
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12fe4d |
+ jb less_than_8
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6d8727 |
+
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12fe4d |
;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
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12fe4d |
;; 1) ALIGN: ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
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6d8727 |
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