|
 |
9ae3a8 |
From 12623687c4bd5eeb5b3ca8f23cf3b646357e2bc3 Mon Sep 17 00:00:00 2001
|
|
|
9ae3a8 |
From: Marcelo Tosatti <mtosatti@redhat.com>
|
|
|
9ae3a8 |
Date: Tue, 20 Aug 2013 21:42:24 +0200
|
|
|
9ae3a8 |
Subject: [PATCH 25/28] kvm: i386: fix LAPIC TSC deadline timer save/restore
|
|
|
9ae3a8 |
|
|
|
9ae3a8 |
RH-Author: Marcelo Tosatti <mtosatti@redhat.com>
|
|
|
9ae3a8 |
Message-id: <20130820214224.GA9334@amt.cnet>
|
|
|
9ae3a8 |
Patchwork-id: 53623
|
|
|
9ae3a8 |
O-Subject: [RHEL7 qemu-kvm PATCH] kvm: i386: fix LAPIC TSC deadline timer save/restore
|
|
|
9ae3a8 |
Bugzilla: 972433
|
|
|
9ae3a8 |
RH-Acked-by: Paolo Bonzini <pbonzini@redhat.com>
|
|
|
9ae3a8 |
RH-Acked-by: Eduardo Habkost <ehabkost@redhat.com>
|
|
|
9ae3a8 |
RH-Acked-by: Gleb Natapov <gleb@redhat.com>
|
|
|
9ae3a8 |
|
|
|
9ae3a8 |
BZ: 972433
|
|
|
9ae3a8 |
|
|
|
9ae3a8 |
commit 7477cd3897082d2650d520a4e9aa7f8affa3dd5d of uq/master branch
|
|
|
9ae3a8 |
of qemu-kvm.git repository
|
|
|
9ae3a8 |
|
|
|
9ae3a8 |
The configuration of the timer represented by MSR_IA32_TSCDEADLINE depends on:
|
|
|
9ae3a8 |
|
|
|
9ae3a8 |
- APIC LVT Timer register.
|
|
|
9ae3a8 |
- TSC value.
|
|
|
9ae3a8 |
|
|
|
9ae3a8 |
Change the order to respect the dependency.
|
|
|
9ae3a8 |
|
|
|
9ae3a8 |
Signed-off-by: Marcelo Tosatti <mtosatti@redhat.com>
|
|
|
9ae3a8 |
Signed-off-by: Paolo Bonzini <pbonzini@redhat.com>
|
|
|
9ae3a8 |
Signed-off-by: Miroslav Rezanina <mrezanin@redhat.com>
|
|
|
9ae3a8 |
---
|
|
|
9ae3a8 |
target-i386/kvm.c | 29 ++++++++++++++++++++++++++---
|
|
|
9ae3a8 |
1 files changed, 26 insertions(+), 3 deletions(-)
|
|
|
9ae3a8 |
|
|
|
9ae3a8 |
diff --git a/target-i386/kvm.c b/target-i386/kvm.c
|
|
|
9ae3a8 |
index 8da6a0d..c5a9416 100644
|
|
|
9ae3a8 |
--- a/target-i386/kvm.c
|
|
|
9ae3a8 |
+++ b/target-i386/kvm.c
|
|
|
9ae3a8 |
@@ -1042,6 +1042,26 @@ static void kvm_msr_entry_set(struct kvm_msr_entry *entry,
|
|
|
9ae3a8 |
entry->data = value;
|
|
|
9ae3a8 |
}
|
|
|
9ae3a8 |
|
|
|
9ae3a8 |
+static int kvm_put_tscdeadline_msr(X86CPU *cpu)
|
|
|
9ae3a8 |
+{
|
|
|
9ae3a8 |
+ CPUX86State *env = &cpu->env;
|
|
|
9ae3a8 |
+ struct {
|
|
|
9ae3a8 |
+ struct kvm_msrs info;
|
|
|
9ae3a8 |
+ struct kvm_msr_entry entries[1];
|
|
|
9ae3a8 |
+ } msr_data;
|
|
|
9ae3a8 |
+ struct kvm_msr_entry *msrs = msr_data.entries;
|
|
|
9ae3a8 |
+
|
|
|
9ae3a8 |
+ if (!has_msr_tsc_deadline) {
|
|
|
9ae3a8 |
+ return 0;
|
|
|
9ae3a8 |
+ }
|
|
|
9ae3a8 |
+
|
|
|
9ae3a8 |
+ kvm_msr_entry_set(&msrs[0], MSR_IA32_TSCDEADLINE, env->tsc_deadline);
|
|
|
9ae3a8 |
+
|
|
|
9ae3a8 |
+ msr_data.info.nmsrs = 1;
|
|
|
9ae3a8 |
+
|
|
|
9ae3a8 |
+ return kvm_vcpu_ioctl(CPU(cpu), KVM_SET_MSRS, &msr_data);
|
|
|
9ae3a8 |
+}
|
|
|
9ae3a8 |
+
|
|
|
9ae3a8 |
static int kvm_put_msrs(X86CPU *cpu, int level)
|
|
|
9ae3a8 |
{
|
|
|
9ae3a8 |
CPUX86State *env = &cpu->env;
|
|
|
9ae3a8 |
@@ -1065,9 +1085,6 @@ static int kvm_put_msrs(X86CPU *cpu, int level)
|
|
|
9ae3a8 |
if (has_msr_tsc_adjust) {
|
|
|
9ae3a8 |
kvm_msr_entry_set(&msrs[n++], MSR_TSC_ADJUST, env->tsc_adjust);
|
|
|
9ae3a8 |
}
|
|
|
9ae3a8 |
- if (has_msr_tsc_deadline) {
|
|
|
9ae3a8 |
- kvm_msr_entry_set(&msrs[n++], MSR_IA32_TSCDEADLINE, env->tsc_deadline);
|
|
|
9ae3a8 |
- }
|
|
|
9ae3a8 |
if (has_msr_misc_enable) {
|
|
|
9ae3a8 |
kvm_msr_entry_set(&msrs[n++], MSR_IA32_MISC_ENABLE,
|
|
|
9ae3a8 |
env->msr_ia32_misc_enable);
|
|
|
9ae3a8 |
@@ -1705,6 +1722,12 @@ int kvm_arch_put_registers(CPUState *cpu, int level)
|
|
|
9ae3a8 |
return ret;
|
|
|
9ae3a8 |
}
|
|
|
9ae3a8 |
}
|
|
|
9ae3a8 |
+
|
|
|
9ae3a8 |
+ ret = kvm_put_tscdeadline_msr(x86_cpu);
|
|
|
9ae3a8 |
+ if (ret < 0) {
|
|
|
9ae3a8 |
+ return ret;
|
|
|
9ae3a8 |
+ }
|
|
|
9ae3a8 |
+
|
|
|
9ae3a8 |
ret = kvm_put_vcpu_events(x86_cpu, level);
|
|
|
9ae3a8 |
if (ret < 0) {
|
|
|
9ae3a8 |
return ret;
|
|
|
9ae3a8 |
--
|
|
|
9ae3a8 |
1.7.1
|
|
|
9ae3a8 |
|